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產業動態 低功耗之通訊數位電路設計即將開課,歡迎蒞臨
工業技術研究院 本新聞稿發佈於2006/07/31,由發布之企業承擔內容之立場與責任,與本站無關

隨著行動終端裝置從以語音為主要應用,發展到需要更強大應用和圖形處理器的可攜式多媒體娛樂設備,電子工程師正面臨了前所未有的困難挑戰,除了要滿足消費者多元化娛樂功能的需求外、裝置外型設計也須輕薄短小,然而,為了使行動設備在功能不會減弱的情況下延長工作時間,擁有出色的電源管理、及保持低功耗的能力便是其性能表現的重要關鍵。因此,低功耗的晶片設計技術之發展,也成為當前最迫切的課題。

 
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從理論上看,數位電路的功耗來主要可分為兩部分:一個是來自邏輯轉換的動態功耗(dynamic power),另一個是CMOS電晶體中各種泄漏機制產生的靜態功耗(static power);進入深次微米製程的時代,包括動態功耗及靜態功耗之電源管理,不再只是晶片設計後段才須考量的因素。隨著邏輯閘數目增加、頻率提高及負載電容的加大,動態功耗也日益增加。此外,缺乏效率的電源管理使電池的壽命縮短、晶片尺寸增加與效能降低,甚至使晶片的功能無法正常運作。因此在晶片設計階段即需考量各種可能造成功耗的因素。

為找出更有效之低功耗電路設計方法,需要對各元件電路的特性有完整的了解及分析,以在低耗電和高效能之間尋找最適的平衡點。有鑑於此,主辦單位特別邀請現任Department of Electrical and Computer Engineering, University of Minnesota的大師級教授GERALD SOBELMAN來台,開設為期兩天、小而精美的高階技術課程,從理論面及應用面分享低功耗通訊數位電路設計之專業經驗,課程從CMOS數位電路設計談起,並介紹靜態漏電流防制技術、動態電源轉換防制技術、低功耗匯流排、低功耗SRAM電路、數位通訊系統設計等,進而深入通訊元件之放大器、數位濾波器、FFTs等應用。

此外,Dr. SOBELMAN對於低功率及高性能之數位電路設計相當專精,特別是通訊應用之電路設計、訊號處理等領域,除了在The Rockefeller University、Sperry Corporation、Control Data Corporation等單位均具有多年之實務經驗,還曾經受邀至IBM, HP and Boeing等知名企業授課,並曾擔任Bermai, Theseus Logic and Rosemount Corp.等多家企業的顧問,透過此一國際級大師的專業講解、與精心設計的豐富課程內容,將是您進階低功耗之通訊數位電路設計領域的最佳管道!

更多課程詳情請參考網站:http://www.ccltrain.net

- 新聞稿有效日期,至2006/08/31為止


聯絡人 :錢卉真
聯絡電話:02-26557600-123
電子郵件:money@a-jau.net

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