主辦單位:經濟部工業局 協辦單位:中研院 承辦單位:台大慶齡工業中心 上課時間: 8/12~10/14 每週六 上午 9:00~16:00;共計60小時 本課程乃利用Verilog硬體描述語言(HDL)及數位邏輯設計能力為基礎,來訓練學員完成複雜的進階數位電路的設計。內容包括有撰寫進階的Verilog硬體描述語法、測試平台及電路模擬,並且加強硬體設計、電路合成及系統整合概念。選修本課程的學員將可提升對數位電路晶片與系統設計的能力,並運用有效率的Verilog硬體描述語言來實作出至少有十二項指令且具pipeline/hazard-detection功能之MIPS CPU設計,同時課程中亦特地加強目前最新的信號及電源完整性(Signal/Power Integrity)的設計觀念。 課程內容: 1.Verilog HDL Overview 2.Simulation & Verification 3.Logic Design 4.State Machine Design 5.Synthesis Issue 6.Arithmetic Processors Design 7.FPGA Labs 8.Signal/Power Integrity 9.Digital System Integration 10.Final Project
參加對象:任職於半導體產業暨相關業者之在職人員或有相關技術需求者。 (可獲政府補助50%費用) 課程費用: 總計24,000元;政府補助12,000元;學員自付新台幣 12,000元
報名專線:02-23628136 及 02-23693661 轉分機 48 更多詳細內容請上http://www.tl.ntu.edu.tw/online.asp - 新聞稿有效日期,至2006/08/30為止
聯絡人 :趙小姐 聯絡電話:02-23628136轉47 電子郵件:tren@tl.ntu.edu.tw
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