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產業動態 Xilinx展示56G PAM4收發器技術
世紀奧美公關顧問 本新聞稿發佈於2016/03/15,由發布之企業承擔內容之立場與責任,與本站無關

美商賽靈思今日宣布運用4階脈衝振幅調變(PAM4)傳輸方式的56G收發器技術,開發出以16nm FinFET+為基礎的可編程元件。針對下個世代的線路速率,PAM4解決方案是業界公認最具可擴展性的傳訊協定,將加倍現有基礎架構頻寬,進而協助推動下一波光纖和銅線互連乙太網路的部署。

 
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瞄準下個世代高密度400G與Terabit介面
實現下一波乙太網路部署

美商賽靈思(Xilinx, Inc.;NASDAQ:XLNX)今日宣布運用4階脈衝振幅調變(PAM4)傳輸方式的56G收發器技術,開發出以16nm FinFET+為基礎的可編程元件。針對下個世代的線路速率,PAM4解決方案是業界公認最具可擴展性的傳訊協定,將加倍現有基礎架構頻寬,進而協助推動下一波光纖和銅線互連乙太網路的部署。賽靈思正在推廣與展示超越一般PAM4可用性的56G技術創新,協助教育供應商和產業生態系成員,使其為技術轉移作好準備。

賽靈思SerDes技術事業群副總裁Ken Chang表示:「客戶早已開始期待如何加快下個世代的應用,這讓我們意識到現在必須提高對56G PAM4技術解決方案的認識,以協助客戶轉移他們的設計,而我們也很高興能藉此展示賽靈思的技術。」

隨著雲端運算、工業物聯網、軟體定義網路等趨勢持續增長,推動對無限頻寬的需求,技術創新必須擴展至50G、100G、400G連接埠和Terabit介面,以在不增加每位元的成本和功耗下最大化連接埠密度。標準化線路速率是滿足下個世代不斷提高頻寬需求的關鍵。在光學互連網路論壇(OIF)與國際電機電子工程師學會(IEEE),賽靈思在56G PAM4的標準化工作中發揮領導作用。賽靈思所開發的56G PAM4收發器技術用以突破線路速率、插入損耗及串音等傳統資料傳輸的物理限制。此技術支援晶片對晶片、模組、直接連接纜線或背板應用的銅線和光學互連,將帶來超越Terabit線路卡及400G到Terabit機箱背板的次世代系統設計。

台積公司北美區副總裁Sajiv Dalal表示:「台積公司與賽靈思合作聯手打造16nm FinFET+ PAM4元件,此突破性的收發器技術是我們與賽靈思雙方長期良好合作的新里程碑。我們將共同朝向高效能運算邁進,同時亦相當期待賽靈思於3月下旬的領先技術展示。」

賽靈思將於2016年3月22─24日在美國加州安納罕的光纖通訊展及研討會(OFC)(攤位:3457)上,展出56G PAM4收發器技術。欲瞭解更多賽靈思56G收發器技術資訊,請瀏覽http://www.xilinx.com/products/technology/high-speed-serial/56g.html網站。

關於賽靈思
賽靈思公司(Xilinx, Inc.;NASDAQ:XLNX)是全球All Programmable FPGA、MPSoC、SoC與3D ICs的領導廠商,獨具一格的實現兼備軟體定義和硬體最佳化特性的各種應用,促進雲端運算、SDN/NFV、視訊/視覺、工業物聯網和5G無線通訊系統等產業的進步。欲瞭解更多賽靈思公司資訊,請瀏覽www.xilinx.com網站。

- 新聞稿有效日期,至2016/04/15為止


聯絡人 :詹承婺
聯絡電話:(02) 2577-2100
電子郵件:WinnieCW.Chan@eraogilvy.com

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