[開課時間] 96 年 5 月 14 日 至 6 月 14 日，每週一及四，18:30~21:30，共計30小時。
[上課費用] 8000元
[上課地點] 國立交通大學工程四館(新竹市大學路1001號)
[開課講者]
黃弘一 教授 / 國立台北大學電機研究所副教授
經歷：工研院電通所課長，輔仁大學電子系副教授
專長：數位類比混合積體電路設計、低功率與高速積體電路與系統設計、(sub-100nm)奈米積體電路設計
[開課大綱]
1. CMOS Processing Flow and Layout Design Rules
2. Layout Styles of MOS Transistors
3. Layout Styles of Resistors, Capacitors, and Inductors
4. Standard Cell Library Layout
5. Layout of Latch-Up and ESD
6. Analog Layout Considerations
7. Power Distribution and Signal-Integrity of Mixed-Signal IC
8. Floor Planning of Mixed-Signal IC
9. Noise Sources and Analysis of Mixed-Signal IC
10. Noise Reduction Techniques of Mixed-Signal IC [報名] 請至網站http://submic.ee.nctu.edu.tw首頁[開課報名]登錄或洽國立交通大學電子系人才培訓中心
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